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ELSYS Design recrutement

Ingénieur en Vérification Uvm pour Cible Asic - Fpga - Soc H/F ELSYS Design

Vallauris - 06
CDI
Résumé de l'offre
  • 40 000 - 60 000 € / an
  • Bac +5
  • Banque • Assurance • Finance
  • Exp. 1 à 7 ans

Détail du poste

Nous recherchons un ingénieur en microélectronique, justifiant d'une première expérience réussie en vérification au niveau IP ou system (top level) de SoC.

Voici l'ensemble de vos responsabilités :
- Capacité à rédiger et critiquer des plans de vérification précis et faciles à réutiliser.
- Expertise avancée dans le développement de code réutilisable et scalable, avec une profonde maîtrise du System Verilog et une compétence avérée en méthodologie UVM.
- Solide compétence dans la planification exhaustive et l'écriture précise de la couverture fonctionnelle ainsi que la couverture de code (coverage) pour assurer une vérification rigoureuse.
- Maîtrise avancée des langages de script tels que Python, Perl, Tcl, démontrant la capacité à concevoir des scripts pour automatiser et optimiser les nouveaux flux de travail de vérification.
- Familiarité approfondie avec les outils de pointe et les processus avancés liés au développement de bancs de tests, englobant tous les aspects du cycle de vérification (Siemens / Cadence / Synopsys)
- Expérience significative avec les langages C/C++, attestant de la capacité à rédiger des tests de base en C pour renforcer la vérification système globale.
- Communication facile pour échanger avec les autres membres de l'équipe et les autres métiers (design / DFT / backend)

Ingénieur en micro-électronique de formation, vous justifiez d'une première expérience significative en Vérification de code RTL avec la méthodologie UVM.

De plus vous avez déjà acquis les compétences suivantes :
- Maîtrise étendue de la vérification de System-on-Chip (SoC) en utilisant la méthodologie UVM.
- Expertise approfondie dans la conception et l'implémentation de tests dirigés en langage C, illustrant une polyvalence technique.
- Excellente compétence dans l'utilisation de langages de programmation variés, tels que VHDL, Verilog/SystemVerilog, C embarqué, Specman.
- Capacité à aborder les défis de la vérification de manière holistique, en adaptant les langages aux exigences spécifiques de chaque situation.
- Aisance en anglais, aussi bien à l'oral qu'à l'écrit, facilitant une communication efficace au sein d'équipes internationales.

L'adresse du poste

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Infos complémentaires

40 000 - 60 000 Eur (€)

Ingénieur en Vérification Uvm pour Cible Asic - Fpga - Soc H/F
  • Vallauris - 06
  • CDI
Publiée le 14/04/2025 - Réf : E-V-20250414-76551

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